来源：百度文库 编辑：查人人中国名人网 时间：2024/04/29 05:54:15
Figure 18 shows the ADF4360-1 used as a fixed frequency LO at 2.2 GHz. The low-pass filter was designed using ADIsimPLL for a channel spacing of 8 MHz and an open-loop bandwidth of 40 kHz. The maximum PFD frequency of the ADF4360-1 is 8 MHz. Because using a larger PFD frequency allows users to use a smaller N, the in-band phase noise is reduced to as low as possible, –99 dBc/Hz. The 40 kHz bandwidth is chosen to be just greater than the point at which the open-loop phase noise of the VCO is –99 dBc/Hz, thus giving the best possible inte-grated noise. The typical rms phase noise (100 Hz to 100 kHz) of the LO in this configuration is 0.3°. The reference frequency is from a 16 MHz TCXO from Fox, thus an R value of 2 is pro-grammed. Taking into account the high PFD frequency and its effect on the band select logic, the band select clock divider is enabled. In this case, a value of 8 is chosen. A very simple pull-up resistor and dc blocking capacitor complete the RF output stage.
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图18 显示ADF4360-1 被使用作为一个固定的频率低在2.2 千兆赫。低通过滤器被设计了使用ADIsimPLL 为8 兆赫频道间隔和40 千赫开放环路的带宽。ADF4360-1 的最大值PFD 频率是8 兆赫。由于使用一个更大的PFD 频率允许用户使用更小的N, in-band
阶段噪声被减少到尽可能低, -99 dBc/Hz 。40 千赫带宽被选择公正大于VCO 开放环路的阶段噪声是-99 dBc/Hz 的点, 如此给最好联合噪声。典型的rms 阶段噪声(100 赫兹到100 千赫) 低在这种配置是0.3. 。参考频率是从一16 兆赫TCXO 从狐狸, 因而R 价值的2 被编程。考虑到高PFD 频率和它的对带精选的逻辑的作用, 带精选的时钟分切器使能。在这种情况下, 价值的8 被选择。一非常简单拉扯电阻器并且dc 阻拦的电容器完成RF 产品阶段。
图 18 表演 ADF4360-1 用如固定的频率瞧! 以 2.2个十亿赫兹。 低途径过滤器被设计使用 ADIsimPLL 作为一个 8个百万赫兹的频道留间隔和一个 40 仟赫的公开- 环带宽。 最大 ADF4360-1 的 PFD 频率是 8个百万赫兹。因为使用较大的 PFD 频率允许使用者使用较小的 N,在- 乐团的噪音尽可能低下地被减少到的状态，– 99 dBc/赫兹。40 仟赫带宽被选择比点更确实更棒在哪一公开- 环的 VCO 的状态噪音是– 99 dBc/赫兹,如此给最好可能 inte 炉篦的噪音。 典型的 rms 状态噪音 (100个赫兹到 100 仟赫) 那瞧! 在这一个结构中是 0.3 °。 叁考频率来自来自福克斯的 16 百万赫兹 TCXO, 如此 2 的 R 价值是职业者克的。 轮流进入解释在乐团方面的高 PFD 频率和它的效果之内选择逻辑,乐团选择时钟分配的人被能够。 在这情况， 8 的价值被选择。 一非常简单的拉- 提高电阻而且直流阻断电容器完成射频输出阶段。
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